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演算器アレイ型アクセラレータにおけるメモリアクセス機構の最適化

演算器アレイ型アクセラレータにおけるメモリアクセス機構の最適化

エンザンキ アレイガタ アクセラレータ ニ オケル メモリ アクセス キコウ ノ サイテキカ

下岡俊介

生駒 : 奈良先端科学技術大学院大学, 2012.3

Thesis / Diss.

Volume No.

Total: 1
No. Printing year Location Call Number Material ID Circulation class Status Waiting

1

R009015

2

  • [IS]2012(7)

Restricted

Details

Publication year

2012

Alternative title

Optimizing Memory Access Controller for FU Array Accelerator

Series title

奈良先端科学技術大学院大学情報科学研究科修士論文 ; 2012年3月

Note

学位記番号: 修第5307号

学位授与年月日: 2012/3/23

学位の種類: 修士(工学)

学生番号: 1051054

Country of publication

Japan

Title language

Japanese (jpn)

Language of texts

Japanese (jpn)

Author information

下岡, 俊介 (シタオカ, シュンスケ)

Subject

高電力効率アクセラレータ

マイクロアーキテクチャ

メモリアクセス機構

CGRA