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SMTプロセッサ向けの正確な記憶階層モデルの構築

SMTプロセッサ向けの正確な記憶階層モデルの構築

SMT プロセッサ ムケ ノ セイカクナ キオク カイソウ モデル ノ コウチク

市來亮人

生駒 : 奈良先端科学技術大学院大学, 2009.3

Thesis / Diss.

Volume No.

Total: 1
No. Printing year Location Call Number Material ID Circulation class Status Waiting

1

R006688

2

  • [IS]2009(6)

Restricted

Details

Publication year

2009

Alternative title

Accurate Modeling of Memory Hierarchy for SMT Processors

Series title

奈良先端科学技術大学院大学情報科学研究科修士論文 ; 2009年3月

Note

学位記番号: 修第4257号

学位授与年月日: 2009/03/24

学位の種類: 修士(工学)

学生番号: 0751009

Country of publication

Japan

Title language

Japanese (jpn)

Language of texts

Japanese (jpn)

Author information

市來, 亮人 (イチキ, アキヒト)

Subject

組込み機器

SMTプロセッサ

記憶階層

評価環境